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凡亿专栏 | AD-全能19期-张吕 pcb第五次作业-usb模块设计
AD-全能19期-张吕 pcb第五次作业-usb模块设计

注意差分信号包地包全:

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差分走线可以优化对称点:

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差分连接进入过孔的 看是否有多余线头 优化走线:

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此处差分对内等长的走线不满足规范:

image.png


此处相同网络的GND铜皮并未跟焊盘连接:

image.png


image.png


铜皮属性设置第二项 然后重新灌铜。


CC1 CC2 管脚需要加粗走线:

image.png


对内等长GAP需要大于等于3W:

image.png


差分走线一定全部需要满足耦合 按照间距走线:

image.png

很多差分都需要优化。


差分连接到过孔没有耦合走线:

image.png


GND平面并未赋予网络:

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还有较多问题 需要修改。



以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
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