凡亿专栏 | 全能19期-AD-第六次设计作业-USB3.0和TYPEC设计
全能19期-AD-第六次设计作业-USB3.0和TYPEC设计

差分走线包地尽量包全:

image.png


此处扇孔重新优化下:

image.png


此处连接两个过孔一起连接上,不然另一个过孔没有用:

image.png


CC1 CC2信号需要加粗走线:

image.png

image.png


此处差分走线完全不耦合 ,不合格:

image.png


image.png


image.png


差分对内等长注意需要符合规范:

image.png


好多差分走线以及对内等长不符合规范,都需要修改。


image.png

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169

lALPM4AfHPIY4mTNAQDNAQQ_260_256.png_720x720.jpg














声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表凡亿课堂立场。文章及其配图仅供工程师学习之用,如有内容图片侵权或者其他问题,请联系本站作侵删。
相关阅读
进入分区查看更多精彩内容>
精彩评论

暂无评论