全能20期-（谢程鑫）-第5次作业-一片SDRAM模块的PCB设计
器件尽量整体中心对齐：
等长线的gap大于等于3W：
地址数据等长误差没什么问题 ，都在误差范围内：
其他的基本没什么问题，完成得还可以。
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