原理图设计是电子工程师的基本功，但哪怕是老手也可能被细节绊倒。今天咱们就白话聊聊，做原理图时最容易碰到的糟心事儿。

1. 符号画错，元件“张冠李戴”

电阻标成电容，三极管引脚顺序搞反

自定义符号没检查，后期改到崩溃

2. 连线“打架”，信号绕地球

线走得歪七扭八，像团乱麻

交叉线没打点，短路隐患藏得深

3. 电源地规划乱，噪声满天飞

电源符号不统一，电压值标得像谜语

地回路没分开，EMC测试直接挂

4. 注释偷懒，团队“大眼瞪小眼”

关键信号不标注，新人看图直挠头

版本更新不标记，改错责任扯不清

5. 规则设置漏，DRC报错堆成山

线宽间距没设，生产时哭晕在车间

约束文件没同步，PCB布线全白干

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