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基于FPGA的低压差正压可调稳压器应用电路设计
电路之家
2017-01-01 00:00:00
1302
关注
LDO
(低压差
线性稳压器
),
FPGA
需要3.3V、2.5V和1.2V,可选用
凌力尔特
LINEAR
:LT1083/84/85,低压差正压可调稳压器。应用
电路
如图所示:输入端加10UF电解
电容
,输出端加10UF胆电容。基本可调稳压器电路图如上图所示,通过改变R1、R2阻值输出需要的电压值,由于Iadj很小,计算时可以忽略不计。故等式变为:,其中,
Vr
ef=1.25V。
电路板
电源设计如下图所示:3.3V:R1=100Ω,R2=162Ω2.5V:R1=R2=100Ω1.2V:ADJ直接接地,1.25V≈1.2V
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