凡亿专栏 | Allegro-弟子-袁鹏——第七次作业——百兆网口模块
Allegro-弟子-袁鹏——第七次作业——百兆网口模块

器件跟信号线还没有设计完全:

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器件之间注意间距,不要干涉了:

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注意器件需要整体对齐处理:

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此处器件重新放置下,注意整体对齐:

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器件就近IC管脚边放置:

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后期自己重新整体布局都优化下。


差分打孔换层两边注意放置GND过孔:

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差分走线一定要耦合,此处完全不耦合了:

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变压器内部都要全部挖空的,不要走线:

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RX TX并未设置等长组进行等长:

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差分组组内等长误差为5MIL。没有满足:

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自己后期还要修改布局以及走线等长 。


以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
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