设计收发器芯片的PCB，最怕信号“翻车”——要么被干扰成“雪花屏”，要么直接“失联”。其实，布局布线只要抓住8个核心点，就能让信号稳得像焊在板上。

1. 布局

核心芯片优先“占C位”：收发器芯片（如MAX485、RTL8211F）必须放在板子中心，远离电源、时钟、电机等“噪声源”。

信号流向“一条龙”：输入→芯片→输出，路径要直，别让信号绕弯路。

敏感元件“隔离区”：模拟信号（如ADC输入）、高频信号（如射频）单独划区域，和数字信号“老死不相往来”。

发热元件“散装”布局：功率管、稳压器等发热大户分散放，别挤在一起“烤板子”。

2. 电源

电源层“专层专用”：多层板用独立电源层，单层板用粗铜皮铺电源线，避免“细线供血”导致压降。

去耦电容“贴身护卫”

0.1μF陶瓷电容+10μF电解电容，电容地端用短粗线连地平面。

星型拓扑“分家不分心”：多电源引脚用星型布线，主节点放大电容（如2.2μF），分支线加小电容（如10nF）。

3. 地线

完整地平面“铺满底”：信号线下方必须有连续地平面，别让回流路径“绕地球一圈”。

单点接地“防串扰”：模拟地、数字地、功率地只在电源入口处用0Ω电阻或磁珠连接，避免“地环路”搞事情。

接地过孔“密集打桩”：芯片GND引脚、去耦电容地端、连接器屏蔽壳，每处至少打3个过孔连地平面。

4. 差分信号

差分对“手拉手”：如RS-485的A/B线、USB的D+/D-，必须平行、等长、等距，间距保持2-3倍线宽。

长度差“掐表控制”：差分对内长度差≤5mil（0.127mm），用蛇形线调整时，拐弯用圆弧或45°角。

换层“带保镖”：差分对换层时，附近加接地过孔，为回流提供“近路”。

5. 时钟信号

时钟线“最短最直”：从晶振到芯片的路径尽量短，远离电源、高速信号线，避免“被噪声绑架”。

晶振下方“铺铜隔离”：晶振下方别走线，铺铜隔离，防止噪声“漏”到其他信号。

包地处理“加防护栏”：时钟线两侧用地线包围，地线上密集打接地过孔，形成“屏蔽罩”。

6. 高速信号

阻抗“算清楚再动手”：高速信号（如PCIe、HDMI）需严格计算线宽、线距、介质厚度，确保特征阻抗匹配（如50Ω单端、100Ω差分）。

避免过孔“乱插队”：高速信号路径上尽量少打过孔，必须打时用小孔径，并注意阻抗连续性。

参考平面“不跨区”：高速信号线下方参考平面必须完整，严禁跨分割区，否则信号会“迷路”。

7. 串扰控制

3W原则“防偷听”：高速信号线中心间距≥3倍线宽，敏感信号（如小信号ADC输入）间距≥5倍线宽。

中间加地线“当保镖”：关键信号线中间加地线隔离，地线宽度≥信号线宽，并密集打接地过孔。

避免平行长距离“贴脸走”：高速信号线与电源线、时钟线别长距离平行，必须交叉时尽量垂直。

8. EMI防护

TVS管“贴身防弹”：连接器信号引脚旁放TVS二极管（如SMBJ6.5CA），接地端用短粗线连地平面。

隔离地“单点连接”：连接器金属外壳通过高压电容（如1nF/2kV）+电阻（如1MΩ）单点连地，防止静电“炸板”。

磁珠/电感“过滤噪声”：电源入口处加磁珠或电感，滤除高频噪声，让电源更干净。

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